Keysight progresse dans la vérification des puces de bout en bout

Báo Thanh niênBáo Thanh niên03/06/2023


L’étape finale du processus de conception de la puce, appelée fabrication de bandes de silicium, est un processus rigoureux et coûteux qui laisse peu de place aux erreurs de conception. Si une conception échoue après la période de test, les fabricants de puces devront lancer un nouveau cycle de « respin », qui peut prendre jusqu'à 12 mois ou plus. Non seulement ce retard dans la refonte nécessite des ressources de recherche et développement supplémentaires et coûteuses, mais il peut également empêcher les fabricants de puces de commercialiser leurs produits à temps.

Keysight đẩy mạnh công nghệ giúp xác minh sản phẩm chip hoàn chỉnh - Ảnh 1.

Keysight Technologies propose une large gamme de solutions de mesure et de test.

La plate-forme Keysight USPA fournit un jumeau numérique de signaux complets permettant aux concepteurs et aux ingénieurs de puces de vérifier les conceptions avant de passer à la fabrication de puces afin de minimiser le risque d'erreurs de conception et les coûts de refonte. La plate-forme USPA intègre des convertisseurs de signaux ultra-rapides avec un système de prototypage FPGA hautes performances, offrant aux concepteurs une alternative aux systèmes de prototypage propriétaires et personnalisés.

En outre, la solution fournit également des interfaces d'entrée/sortie adaptées aux applications telles que le développement d'applications radio 6G, la mémoire de radiofréquence numérique, la recherche en physique avancée et les applications d'acquisition de données à grande vitesse, telles que le radar et la radioastronomie.

« La plateforme USPA de Keysight accélère et réduit les risques liés au processus de développement de puces, en fournissant une nouvelle solution qui répond aux défis des conceptions de pointe dans des environnements à coûts élevés », a déclaré le Dr Joachim Peerlings, vice-président et directeur général du groupe Network and Data Center Solutions de Keysight. « Cette puissante plateforme fournit aux développeurs de puces un jumeau numérique de leur futur silicium, leur permettant de valider entièrement les conceptions et les algorithmes, en minimisant les risques et les coûts associés aux reconceptions. »



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